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synced 2024-12-23 02:51:21 -08:00
editorconfig: Set default encoding to UTF-8 (#5793)
* editorconfig: Add default charset * Change file encoding from UTF-8-BOM to UTF-8
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1be668e68a
commit
2989c163a8
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#### Core EditorConfig Options ####
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#### Core EditorConfig Options ####
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# Set default charset
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charset = utf-8
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# Indentation and spacing
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# Indentation and spacing
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indent_size = 4
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indent_style = space
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indent_style = space
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@ -1,4 +1,4 @@
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using ARMeilleure.Common;
|
using ARMeilleure.Common;
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using System;
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using System;
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using System.Runtime.CompilerServices;
|
using System.Runtime.CompilerServices;
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@ -1,4 +1,4 @@
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using System;
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using System;
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namespace ARMeilleure.CodeGen.Linking
|
namespace ARMeilleure.CodeGen.Linking
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{
|
{
|
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@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.CodeGen.Linking
|
namespace ARMeilleure.CodeGen.Linking
|
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{
|
{
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||||||
/// <summary>
|
/// <summary>
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/// Types of <see cref="Symbol"/>.
|
/// Types of <see cref="Symbol"/>.
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@ -1,4 +1,4 @@
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|||||||
using ARMeilleure.IntermediateRepresentation;
|
using ARMeilleure.IntermediateRepresentation;
|
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using ARMeilleure.Translation;
|
using ARMeilleure.Translation;
|
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using System.Diagnostics;
|
using System.Diagnostics;
|
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using static ARMeilleure.IntermediateRepresentation.Operand.Factory;
|
using static ARMeilleure.IntermediateRepresentation.Operand.Factory;
|
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@ -1,4 +1,4 @@
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using ARMeilleure.IntermediateRepresentation;
|
using ARMeilleure.IntermediateRepresentation;
|
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using ARMeilleure.Translation;
|
using ARMeilleure.Translation;
|
||||||
using static ARMeilleure.IntermediateRepresentation.Operation.Factory;
|
using static ARMeilleure.IntermediateRepresentation.Operation.Factory;
|
||||||
|
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@ -1,4 +1,4 @@
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|||||||
using System;
|
using System;
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namespace ARMeilleure.CodeGen.RegisterAllocators
|
namespace ARMeilleure.CodeGen.RegisterAllocators
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{
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{
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@ -1,4 +1,4 @@
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using System;
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using System;
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||||||
namespace ARMeilleure.CodeGen.RegisterAllocators
|
namespace ARMeilleure.CodeGen.RegisterAllocators
|
||||||
{
|
{
|
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@ -1,4 +1,4 @@
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using System;
|
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using System.Diagnostics.CodeAnalysis;
|
using System.Diagnostics.CodeAnalysis;
|
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|
namespace ARMeilleure.CodeGen.X86
|
||||||
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@ -1,4 +1,4 @@
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using ARMeilleure.IntermediateRepresentation;
|
using ARMeilleure.IntermediateRepresentation;
|
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|
|
||||||
namespace ARMeilleure.CodeGen.X86
|
namespace ARMeilleure.CodeGen.X86
|
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|
{
|
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@ -1,4 +1,4 @@
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using System;
|
using System;
|
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|
|
||||||
namespace ARMeilleure.CodeGen.X86
|
namespace ARMeilleure.CodeGen.X86
|
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|
{
|
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@ -1,4 +1,4 @@
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using ARMeilleure.CodeGen.Optimizations;
|
using ARMeilleure.CodeGen.Optimizations;
|
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using ARMeilleure.IntermediateRepresentation;
|
using ARMeilleure.IntermediateRepresentation;
|
||||||
using ARMeilleure.Translation;
|
using ARMeilleure.Translation;
|
||||||
using System.Collections.Generic;
|
using System.Collections.Generic;
|
||||||
|
@ -1,4 +1,4 @@
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|||||||
using ARMeilleure.Diagnostics;
|
using ARMeilleure.Diagnostics;
|
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using System;
|
using System;
|
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using System.Collections.Generic;
|
using System.Collections.Generic;
|
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using System.Runtime.InteropServices;
|
using System.Runtime.InteropServices;
|
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|
@ -1,4 +1,4 @@
|
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using System;
|
using System;
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|
|
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namespace ARMeilleure.Common
|
namespace ARMeilleure.Common
|
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|
{
|
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|
@ -1,4 +1,4 @@
|
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using System;
|
using System;
|
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using System.Collections.Generic;
|
using System.Collections.Generic;
|
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using System.Runtime.CompilerServices;
|
using System.Runtime.CompilerServices;
|
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|
|
||||||
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@ -1,4 +1,4 @@
|
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using System;
|
using System;
|
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|
|
||||||
namespace ARMeilleure.Common
|
namespace ARMeilleure.Common
|
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|
{
|
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|
@ -1,4 +1,4 @@
|
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using System;
|
using System;
|
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using System.Collections.Generic;
|
using System.Collections.Generic;
|
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|
using System.Numerics;
|
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|
|
||||||
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@ -1,4 +1,4 @@
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using System;
|
using System;
|
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using System.Runtime.InteropServices;
|
using System.Runtime.InteropServices;
|
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|
|
||||||
namespace ARMeilleure.Common
|
namespace ARMeilleure.Common
|
||||||
|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
enum DecoderMode
|
enum DecoderMode
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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interface IOpCode32AluBf
|
interface IOpCode32AluBf
|
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{
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{
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
||||||
interface IOpCode32AluImm : IOpCode32Alu
|
interface IOpCode32AluImm : IOpCode32Alu
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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interface IOpCode32AluReg : IOpCode32Alu
|
interface IOpCode32AluReg : IOpCode32Alu
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
||||||
interface IOpCode32AluRsImm : IOpCode32Alu
|
interface IOpCode32AluRsImm : IOpCode32Alu
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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|
{
|
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interface IOpCode32AluRsReg : IOpCode32Alu
|
interface IOpCode32AluRsReg : IOpCode32Alu
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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|
{
|
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interface IOpCode32AluUx : IOpCode32AluReg
|
interface IOpCode32AluUx : IOpCode32AluReg
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
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interface IOpCode32Exception
|
interface IOpCode32Exception
|
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{
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
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interface IOpCode32HasSetFlags
|
interface IOpCode32HasSetFlags
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{
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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|
{
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interface IOpCode32MemEx : IOpCode32Mem
|
interface IOpCode32MemEx : IOpCode32Mem
|
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|
{
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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|
{
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interface IOpCode32MemReg : IOpCode32Mem
|
interface IOpCode32MemReg : IOpCode32Mem
|
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{
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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interface IOpCode32Simd : IOpCode32, IOpCodeSimd { }
|
interface IOpCode32Simd : IOpCode32, IOpCodeSimd { }
|
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}
|
}
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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interface IOpCode32SimdImm : IOpCode32Simd
|
interface IOpCode32SimdImm : IOpCode32Simd
|
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{
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{
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32AluBf : OpCode32, IOpCode32AluBf
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class OpCode32AluBf : OpCode32, IOpCode32AluBf
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
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class OpCode32AluImm16 : OpCode32Alu, IOpCode32AluImm16
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class OpCode32AluImm16 : OpCode32Alu, IOpCode32AluImm16
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{
|
{
|
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32AluMla : OpCode32, IOpCode32AluMla
|
class OpCode32AluMla : OpCode32, IOpCode32AluMla
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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class OpCode32AluReg : OpCode32Alu, IOpCode32AluReg
|
class OpCode32AluReg : OpCode32Alu, IOpCode32AluReg
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
class OpCode32AluRsReg : OpCode32Alu, IOpCode32AluRsReg
|
class OpCode32AluRsReg : OpCode32Alu, IOpCode32AluRsReg
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{
|
{
|
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
|
{
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class OpCode32AluUmull : OpCode32, IOpCode32AluUmull
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{
|
{
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|
@ -1,4 +1,4 @@
|
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using ARMeilleure.State;
|
using ARMeilleure.State;
|
||||||
|
|
||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32Exception : OpCode32, IOpCode32Exception
|
class OpCode32Exception : OpCode32, IOpCode32Exception
|
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{
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{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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class OpCode32MemLdEx : OpCode32Mem, IOpCode32MemEx
|
class OpCode32MemLdEx : OpCode32Mem, IOpCode32MemEx
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
||||||
class OpCode32MemReg : OpCode32Mem, IOpCode32MemReg
|
class OpCode32MemReg : OpCode32Mem, IOpCode32MemReg
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{
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
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{
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class OpCode32MemRsImm : OpCode32Mem, IOpCode32MemRsImm
|
class OpCode32MemRsImm : OpCode32Mem, IOpCode32MemRsImm
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{
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{
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|
@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
||||||
class OpCode32MemStEx : OpCode32Mem, IOpCode32MemEx
|
class OpCode32MemStEx : OpCode32Mem, IOpCode32MemEx
|
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{
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|
@ -1,4 +1,4 @@
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using ARMeilleure.State;
|
using ARMeilleure.State;
|
||||||
|
|
||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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||||||
{
|
{
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class OpCode32Simd : OpCode32SimdBase
|
class OpCode32Simd : OpCode32SimdBase
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{
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{
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@ -1,4 +1,4 @@
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using System;
|
using System;
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|
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
|
||||||
{
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{
|
||||||
/// <summary>
|
/// <summary>
|
||||||
/// A special alias that always runs in 64 bit int, to speed up binary ops a little.
|
/// A special alias that always runs in 64 bit int, to speed up binary ops a little.
|
||||||
|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
class OpCode32SimdCmpZ : OpCode32Simd
|
class OpCode32SimdCmpZ : OpCode32Simd
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
class OpCode32SimdCvtFFixed : OpCode32Simd
|
class OpCode32SimdCvtFFixed : OpCode32Simd
|
||||||
{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
class OpCode32SimdCvtFI : OpCode32SimdS
|
class OpCode32SimdCvtFI : OpCode32SimdS
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||||||
{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
class OpCode32SimdDupElem : OpCode32Simd
|
class OpCode32SimdDupElem : OpCode32Simd
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
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class OpCode32SimdDupGP : OpCode32, IOpCode32Simd
|
class OpCode32SimdDupGP : OpCode32, IOpCode32Simd
|
||||||
{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32SimdExt : OpCode32SimdReg
|
class OpCode32SimdExt : OpCode32SimdReg
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32SimdImm : OpCode32SimdBase, IOpCode32SimdImm
|
class OpCode32SimdImm : OpCode32SimdBase, IOpCode32SimdImm
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{
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{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
|
{
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class OpCode32SimdImm44 : OpCode32, IOpCode32SimdImm
|
class OpCode32SimdImm44 : OpCode32, IOpCode32SimdImm
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{
|
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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class OpCode32SimdLong : OpCode32SimdBase
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
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class OpCode32SimdMemImm : OpCode32, IOpCode32Simd
|
class OpCode32SimdMemImm : OpCode32, IOpCode32Simd
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{
|
{
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@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
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{
|
{
|
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class OpCode32SimdMemMult : OpCode32
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class OpCode32SimdMemMult : OpCode32
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{
|
{
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@ -1,4 +1,4 @@
|
|||||||
using ARMeilleure.State;
|
using ARMeilleure.State;
|
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|
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
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@ -1,4 +1,4 @@
|
|||||||
using ARMeilleure.State;
|
using ARMeilleure.State;
|
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|
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
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class OpCode32SimdMovGp : OpCode32, IOpCode32Simd
|
class OpCode32SimdMovGp : OpCode32, IOpCode32Simd
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
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class OpCode32SimdMovGpDouble : OpCode32, IOpCode32Simd
|
class OpCode32SimdMovGpDouble : OpCode32, IOpCode32Simd
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
|
||||||
{
|
{
|
||||||
class OpCode32SimdMovGpElem : OpCode32, IOpCode32Simd
|
class OpCode32SimdMovGpElem : OpCode32, IOpCode32Simd
|
||||||
{
|
{
|
||||||
|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
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class OpCode32SimdReg : OpCode32Simd
|
class OpCode32SimdReg : OpCode32Simd
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{
|
{
|
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@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32SimdRegElem : OpCode32SimdReg
|
class OpCode32SimdRegElem : OpCode32SimdReg
|
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{
|
{
|
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@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32SimdRegElemLong : OpCode32SimdRegElem
|
class OpCode32SimdRegElemLong : OpCode32SimdRegElem
|
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{
|
{
|
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|
@ -1,4 +1,4 @@
|
|||||||
namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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{
|
{
|
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class OpCode32SimdRegLong : OpCode32SimdReg
|
class OpCode32SimdRegLong : OpCode32SimdReg
|
||||||
{
|
{
|
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|
@ -1,4 +1,4 @@
|
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
|
{
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class OpCode32SimdRegS : OpCode32SimdS
|
class OpCode32SimdRegS : OpCode32SimdS
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{
|
{
|
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
|
namespace ARMeilleure.Decoders
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class OpCode32SimdRegWide : OpCode32SimdReg
|
class OpCode32SimdRegWide : OpCode32SimdReg
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{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32SimdRev : OpCode32SimdCmpZ
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class OpCode32SimdRev : OpCode32SimdCmpZ
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32SimdS : OpCode32, IOpCode32Simd
|
class OpCode32SimdS : OpCode32, IOpCode32Simd
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{
|
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32SimdSel : OpCode32SimdRegS
|
class OpCode32SimdSel : OpCode32SimdRegS
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{
|
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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|
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class OpCode32SimdShImm : OpCode32Simd
|
class OpCode32SimdShImm : OpCode32Simd
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{
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|
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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|
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class OpCode32SimdShImmLong : OpCode32Simd
|
class OpCode32SimdShImmLong : OpCode32Simd
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{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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|
class OpCode32SimdShImmNarrow : OpCode32SimdShImm
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32SimdSpecial : OpCode32
|
class OpCode32SimdSpecial : OpCode32
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32SimdSqrte : OpCode32Simd
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class OpCode32SimdSqrte : OpCode32Simd
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32SimdTbl : OpCode32SimdReg
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class OpCode32SimdTbl : OpCode32SimdReg
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCode32System : OpCode32
|
class OpCode32System : OpCode32
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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public static class OpCodeSimdHelper
|
public static class OpCodeSimdHelper
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
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class OpCodeT16AddSubImm3 : OpCodeT16, IOpCode32AluImm
|
class OpCodeT16AddSubImm3 : OpCodeT16, IOpCode32AluImm
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{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16AddSubReg : OpCodeT16, IOpCode32AluReg
|
class OpCodeT16AddSubReg : OpCodeT16, IOpCode32AluReg
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|
{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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{
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class OpCodeT16AluImm8 : OpCodeT16, IOpCode32AluImm
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class OpCodeT16AluImm8 : OpCodeT16, IOpCode32AluImm
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{
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{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16AluImmZero : OpCodeT16, IOpCode32AluImm
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class OpCodeT16AluImmZero : OpCodeT16, IOpCode32AluImm
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16AluRegHigh : OpCodeT16, IOpCode32AluReg
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class OpCodeT16AluRegHigh : OpCodeT16, IOpCode32AluReg
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16AluRegLow : OpCodeT16, IOpCode32AluReg
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class OpCodeT16AluRegLow : OpCodeT16, IOpCode32AluReg
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16BImm11 : OpCodeT16, IOpCode32BImm
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class OpCodeT16BImm11 : OpCodeT16, IOpCode32BImm
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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class OpCodeT16BImm8 : OpCodeT16, IOpCode32BImm
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class OpCodeT16BImm8 : OpCodeT16, IOpCode32BImm
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16BReg : OpCodeT16, IOpCode32BReg
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class OpCodeT16BReg : OpCodeT16, IOpCode32BReg
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{
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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{
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class OpCodeT16Exception : OpCodeT16, IOpCode32Exception
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class OpCodeT16Exception : OpCodeT16, IOpCode32Exception
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@ -1,4 +1,4 @@
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using System.Collections.Generic;
|
using System.Collections.Generic;
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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@ -1,4 +1,4 @@
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using ARMeilleure.Instructions;
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using System;
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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@ -1,4 +1,4 @@
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using ARMeilleure.State;
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using ARMeilleure.State;
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namespace ARMeilleure.Decoders
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@ -1,4 +1,4 @@
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using ARMeilleure.Instructions;
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@ -1,4 +1,4 @@
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class OpCodeT16MemReg : OpCodeT16, IOpCode32MemReg
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@ -1,4 +1,4 @@
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using ARMeilleure.State;
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using ARMeilleure.State;
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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@ -1,4 +1,4 @@
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using ARMeilleure.Instructions;
|
using ARMeilleure.Instructions;
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using ARMeilleure.State;
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using ARMeilleure.State;
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using System;
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using System;
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using System.Numerics;
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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namespace ARMeilleure.Decoders
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class OpCodeT16ShiftImm : OpCodeT16, IOpCode32AluRsImm
|
class OpCodeT16ShiftImm : OpCodeT16, IOpCode32AluRsImm
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@ -1,4 +1,4 @@
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class OpCodeT16ShiftReg : OpCodeT16, IOpCode32AluRsReg
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class OpCodeT16ShiftReg : OpCodeT16, IOpCode32AluRsReg
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@ -1,4 +1,4 @@
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namespace ARMeilleure.Decoders
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class OpCodeT32 : OpCode32
|
class OpCodeT32 : OpCode32
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|
{
|
||||||
|
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